[FPAG开发]使用Vivado创建第一个程序

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1 打开Vivado软件,新建项目

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选择合适的型号

产品 型号
ZYNQ-7010 xc7z010clg400-1
ZYNQ-7020 xc7z010clg400-2

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如果型号选错,可以单击这里重新选择
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2 创建工程源文件

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可以看到文件创建成功
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双击文件打开,插入代码

module led_twinkle(
    input          sys_clk  ,  //系统时钟
    input          sys_rst_n,  //系统复位,低电平有效

    output  [1:0]  led         //LED灯
);

//reg define
reg  [25:0]  cnt ;

//*****************************************************
//**                    main code
//*****************************************************

//对计数器的值进行判断,以输出LED的状态
assign led = (cnt < 26'd2500_0000) ? 2'b01 : 2'b10 ;
//assign led = (cnt < 26'd5)         ? 2'b01 : 2'b10 ;  //仅用于仿真

//计数器在0~5000_000之间进行计数
always @ (posedge sys_clk or negedge sys_rst_n) begin
    if(!sys_rst_n)
        cnt <= 26'd0;
    else if(cnt < 26'd5000_0000)
//  else if(cnt < 26'd10)  //仅用于仿真
        cnt <= cnt + 1'b1;
    else
        cnt <= 26'd0;
end

endmodule

设置字体和缩进
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3 RTL分析综合

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软件会生成一个原理图
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4 引脚约束

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参数 类型 对应的FPGA引脚 I/O std 备注
sys_clk IN U18 LVCMOS33 3.3V电平
sys_rst_n IN N16 LVCMOS33 3.3V电平
led[0] OUT L15 LVCMOS33 3.3V电平
led[1] OUT H15 LVCMOS33 3.3V电平

配置如图所示
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然后使用Ctrl+S保存
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关闭界面
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XDC文件保存了I/O约束的信息
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5 生成比特流

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在这里可以看到进度
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完成之后会出现一个框框,点击Cancel即可

6 下载

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点击这两个地方可以下载程序
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点击Program
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此外可以添加已有的文件到工程中
注意点击Copy source into project[FPAG开发]使用Vivado创建第一个程序,FPAG,fpga开发文章来源地址https://www.toymoban.com/news/detail-647932.html

到了这里,关于[FPAG开发]使用Vivado创建第一个程序的文章就介绍完了。如果您还想了解更多内容,请在右上角搜索TOY模板网以前的文章或继续浏览下面的相关文章,希望大家以后多多支持TOY模板网!

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